四個(gè)驅(qū)動(dòng)單元：context-M3內(nèi)核的D-bus總線和S-bus總線、通用DMA1和通用DMA2。
四個(gè)被驅(qū)動(dòng)的單元：內(nèi)部FLASH（內(nèi)部山村存儲(chǔ)器）、內(nèi)部SRAM、FSMC、AHB到APB的橋AHP2APBx。
ICode總線是context-M3與內(nèi)部閃存FLASH指令接口之間的連接的總線，實(shí)現(xiàn)指令的預(yù)取功能。
DCode總線是將context-M3與內(nèi)部閃存存儲(chǔ)器（FLASH）的數(shù)據(jù)接口連接起來的總線，實(shí)現(xiàn)數(shù)據(jù)讀取。
系統(tǒng)總線（system bus）連接context-M3和總線矩陣，總線矩陣協(xié)調(diào)著context-M3和DMA間的訪問。
DMA總線實(shí)現(xiàn)DMA的AHB主控接口道總線接口的連接。
總線矩陣
此總線矩陣協(xié)調(diào)內(nèi)核系統(tǒng)總線和DMA主控總線之間的訪問仲裁。此仲裁利用輪換算法。此總線矩陣由四個(gè)驅(qū)動(dòng)部件(CPU的DCode、系統(tǒng)總線、DMA1總線和DMA2總線)和四個(gè)被動(dòng)部件(閃存存儲(chǔ)器接口(FLITF)、SRAM、FSMC和AHB2APB橋)構(gòu)成。
AHB外設(shè)通過總線矩陣與系統(tǒng)總線相連，允許DMA訪問。
APB1操作速度限于36MHz，APB2操作于全速(最高72MHz)。
存儲(chǔ)器組織
程序存儲(chǔ)器、數(shù)據(jù)存儲(chǔ)器、寄存器和輸入輸出端口被組織在同一個(gè)4GB的線性地址空間內(nèi)。
數(shù)據(jù)字節(jié)以小端格式存放在存儲(chǔ)器中。一個(gè)字里的最低地址字節(jié)被認(rèn)為是該字的最低有效字
FLASH/代碼區(qū)512M、片上SRAM512M、片上外設(shè)/寄存器區(qū)512M。4G內(nèi)其它的地址空間是保留的地址空間。
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