首次即成功!新思科技助力Achronnix新一代FPGA提前數(shù)月上市
新思科技近日宣布,Achronix半導體公司通過使用新思科技的設(shè)計、驗證和DesignWare IP解決方案,其新一代Speedster7t FPGA成功通過首次硅驗證,產(chǎn)品提前數(shù)月上市。Speedster7t FPGA是Achronix面向人工智能、機器學習和高帶寬數(shù)據(jù)加速應(yīng)用推出的創(chuàng)新性產(chǎn)品。
“Achronix的新一代7納米Speedster7t FPGA可滿足高性能應(yīng)用所需的超大數(shù)據(jù)量處理需求。新思科技廣泛的解決方案可幫我們將設(shè)計風險降至最低,滿足了我們對于嚴格產(chǎn)品設(shè)計和精準上市時間的需求。新思科技的驗證和金牌簽核技術(shù)讓我們的團隊實現(xiàn)了更好的整體設(shè)計收斂,其DesignWare IP可快速實現(xiàn)集成,讓我們提前數(shù)月完成了設(shè)計計劃。”
——Chris Pelosi
硬件工程副總裁
Achronix
新思科技的DesignWare IP產(chǎn)品組合幫助Achronix完美的實現(xiàn)了Speedster7t FPGA對存儲器性能和實時數(shù)據(jù)連接需求。與市面上其他解決方案相比,DesignWare Logic Library IP可將占用面積降低4%,時序提升8%,對于高速設(shè)計而言,這兩項指標的提升至關(guān)重要。此外,DesignWare Embedded Memory IP(包括雙端口SRAM)可降低Speedster7t FPGA的功耗,DesignWare DRD4 IP具有全面和廣泛的可靠性、可用性和可維護性(RAS)能力。PCI Express(PCIe)5.0具有低延遲特性,可支持16條鏈路和512位數(shù)據(jù)路徑寬度,因此可提供更大的帶寬和更好的功耗效率。Achronix非常期待與新思科技的長期合作,并計劃在其下一個設(shè)計中繼續(xù)使用DesignWare IP。
在外形因子受面積和功率限制的情況下,新思科技的Fusion設(shè)計平臺可幫助Achronix實現(xiàn)具有市場塑造力的高帶寬計算所需的性能。測試、執(zhí)行和金牌簽核技術(shù)的融合使Achronix能夠在系統(tǒng)性規(guī)模層面最大限度地減少設(shè)計余量,實現(xiàn)更好的整體設(shè)計收斂,幫助Achronix加速實現(xiàn)了首次硅驗證。
新思科技的定制設(shè)計平臺具有特定節(jié)點的特性,有助于減少設(shè)計、布局和模擬高性能定制電路在7納米Speedster7t FPGA中耗費的時間和精力,極大提高了開發(fā)者的工作效率。
Achronix還采用了新思科技Verification Continuum平臺中的關(guān)鍵功能驗證產(chǎn)品來驗證其FPGA。新思科技的VCS仿真解決方案可以加速仿真性能,其驗證IP可提供更快的驗證環(huán)境創(chuàng)建速度,VC SpyGlass RTL靜態(tài)簽核工具則提供了早期設(shè)計漏洞檢測功能。
“超大規(guī)模數(shù)據(jù)中心的設(shè)計隨著互聯(lián)網(wǎng)流量的大幅增長而不斷發(fā)展,因此需要結(jié)合高性能和低延遲解決方案來實現(xiàn)系統(tǒng)的總吞吐量,新思科技為Achronix等公司提供業(yè)界最全面的設(shè)計、驗證和IP解決方案,可滿足高性能計算設(shè)計的嚴格要求。”
——John Koeter
IP營銷和戰(zhàn)略副總裁
新思科技
新思科技擁有行業(yè)領(lǐng)先的解決方案
Achronix的Speedster7t FPGA配有一系列用于高帶寬、人工智能/機器學習優(yōu)化的高密度機器學習處理器(MLPs)。Achronix采用新思科技的多種解決方案取得了最佳收益,其中包括:
●Fusion Design Platform
包括Design Compiler、IC Compiler II、PrimeTime、PrimePower、StarRC和SiliconSmart
●Custom Design Platform
配備Custom Compiler和PrimeSim Continuum
●IC Validator
●Verification Continuum Platform
配備VCS、VC SpyGlass和Verification IP(VIP)
●DesignWare IP
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